mirror of
https://source.denx.de/u-boot/u-boot.git
synced 2026-06-13 15:03:58 +03:00
global: Migrate CONFIG_SH_ETHER_PHY_ADDR to CFG
Perform a simple rename of CONFIG_SH_ETHER_PHY_ADDR to CFG_SH_ETHER_PHY_ADDR Signed-off-by: Tom Rini <trini@konsulko.com>
This commit is contained in:
@@ -22,7 +22,7 @@
|
||||
|
||||
/* SH Ether */
|
||||
#define CONFIG_SH_ETHER_USE_PORT 0
|
||||
#define CONFIG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CFG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CONFIG_SH_ETHER_PHY_MODE PHY_INTERFACE_MODE_RMII
|
||||
#define CFG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_INVALIDATE
|
||||
|
||||
@@ -15,7 +15,7 @@
|
||||
|
||||
/* SH Ether */
|
||||
#define CONFIG_SH_ETHER_USE_PORT 0
|
||||
#define CONFIG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CFG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CONFIG_SH_ETHER_PHY_MODE PHY_INTERFACE_MODE_RMII
|
||||
#define CFG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_INVALIDATE
|
||||
|
||||
@@ -21,7 +21,7 @@
|
||||
|
||||
/* SH Ether */
|
||||
#define CONFIG_SH_ETHER_USE_PORT 0
|
||||
#define CONFIG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CFG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CONFIG_SH_ETHER_PHY_MODE PHY_INTERFACE_MODE_RMII
|
||||
#define CFG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_INVALIDATE
|
||||
|
||||
@@ -18,7 +18,7 @@
|
||||
|
||||
/* Network interface */
|
||||
#define CONFIG_SH_ETHER_USE_PORT 0
|
||||
#define CONFIG_SH_ETHER_PHY_ADDR 0
|
||||
#define CFG_SH_ETHER_PHY_ADDR 0
|
||||
#define CONFIG_SH_ETHER_PHY_MODE PHY_INTERFACE_MODE_MII
|
||||
#define CFG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_INVALIDATE
|
||||
|
||||
@@ -21,7 +21,7 @@
|
||||
|
||||
/* SH Ether */
|
||||
#define CONFIG_SH_ETHER_USE_PORT 0
|
||||
#define CONFIG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CFG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CONFIG_SH_ETHER_PHY_MODE PHY_INTERFACE_MODE_RMII
|
||||
#define CFG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_INVALIDATE
|
||||
|
||||
@@ -22,7 +22,7 @@
|
||||
|
||||
/* SH Ether */
|
||||
#define CONFIG_SH_ETHER_USE_PORT 0
|
||||
#define CONFIG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CFG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CONFIG_SH_ETHER_PHY_MODE PHY_INTERFACE_MODE_RMII
|
||||
#define CFG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_INVALIDATE
|
||||
|
||||
@@ -23,7 +23,7 @@
|
||||
|
||||
/* SH Ether */
|
||||
#define CONFIG_SH_ETHER_USE_PORT 0
|
||||
#define CONFIG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CFG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CONFIG_SH_ETHER_PHY_MODE PHY_INTERFACE_MODE_RMII
|
||||
#define CFG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_INVALIDATE
|
||||
|
||||
@@ -23,7 +23,7 @@
|
||||
|
||||
/* SH Ether */
|
||||
#define CONFIG_SH_ETHER_USE_PORT 0
|
||||
#define CONFIG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CFG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CONFIG_SH_ETHER_PHY_MODE PHY_INTERFACE_MODE_RMII
|
||||
#define CFG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_INVALIDATE
|
||||
|
||||
@@ -27,7 +27,7 @@
|
||||
|
||||
/* SH Ether */
|
||||
#define CONFIG_SH_ETHER_USE_PORT 0
|
||||
#define CONFIG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CFG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CONFIG_SH_ETHER_PHY_MODE PHY_INTERFACE_MODE_RMII
|
||||
#define CFG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_INVALIDATE
|
||||
|
||||
Reference in New Issue
Block a user