mirror of
https://source.denx.de/u-boot/u-boot.git
synced 2026-06-13 15:03:58 +03:00
global: Migrate CONFIG_SH_ETHER_CACHE_WRITEBACK to CFG
Perform a simple rename of CONFIG_SH_ETHER_CACHE_WRITEBACK to CFG_SH_ETHER_CACHE_WRITEBACK Signed-off-by: Tom Rini <trini@konsulko.com>
This commit is contained in:
@@ -24,7 +24,7 @@
|
||||
#define CONFIG_SH_ETHER_USE_PORT 0
|
||||
#define CONFIG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CONFIG_SH_ETHER_PHY_MODE PHY_INTERFACE_MODE_RMII
|
||||
#define CONFIG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_INVALIDATE
|
||||
#define CFG_SH_ETHER_ALIGNE_SIZE 64
|
||||
|
||||
|
||||
@@ -17,7 +17,7 @@
|
||||
#define CONFIG_SH_ETHER_USE_PORT 0
|
||||
#define CONFIG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CONFIG_SH_ETHER_PHY_MODE PHY_INTERFACE_MODE_RMII
|
||||
#define CONFIG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_INVALIDATE
|
||||
#define CFG_SH_ETHER_ALIGNE_SIZE 64
|
||||
|
||||
|
||||
@@ -23,7 +23,7 @@
|
||||
#define CONFIG_SH_ETHER_USE_PORT 0
|
||||
#define CONFIG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CONFIG_SH_ETHER_PHY_MODE PHY_INTERFACE_MODE_RMII
|
||||
#define CONFIG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_INVALIDATE
|
||||
#define CFG_SH_ETHER_ALIGNE_SIZE 64
|
||||
|
||||
|
||||
@@ -20,7 +20,7 @@
|
||||
#define CONFIG_SH_ETHER_USE_PORT 0
|
||||
#define CONFIG_SH_ETHER_PHY_ADDR 0
|
||||
#define CONFIG_SH_ETHER_PHY_MODE PHY_INTERFACE_MODE_MII
|
||||
#define CONFIG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_INVALIDATE
|
||||
#define CFG_SH_ETHER_ALIGNE_SIZE 64
|
||||
|
||||
|
||||
@@ -23,7 +23,7 @@
|
||||
#define CONFIG_SH_ETHER_USE_PORT 0
|
||||
#define CONFIG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CONFIG_SH_ETHER_PHY_MODE PHY_INTERFACE_MODE_RMII
|
||||
#define CONFIG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_INVALIDATE
|
||||
#define CFG_SH_ETHER_ALIGNE_SIZE 64
|
||||
|
||||
|
||||
@@ -24,7 +24,7 @@
|
||||
#define CONFIG_SH_ETHER_USE_PORT 0
|
||||
#define CONFIG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CONFIG_SH_ETHER_PHY_MODE PHY_INTERFACE_MODE_RMII
|
||||
#define CONFIG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_INVALIDATE
|
||||
#define CFG_SH_ETHER_ALIGNE_SIZE 64
|
||||
|
||||
|
||||
@@ -25,7 +25,7 @@
|
||||
#define CONFIG_SH_ETHER_USE_PORT 0
|
||||
#define CONFIG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CONFIG_SH_ETHER_PHY_MODE PHY_INTERFACE_MODE_RMII
|
||||
#define CONFIG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_INVALIDATE
|
||||
#define CFG_SH_ETHER_ALIGNE_SIZE 64
|
||||
|
||||
|
||||
@@ -25,7 +25,7 @@
|
||||
#define CONFIG_SH_ETHER_USE_PORT 0
|
||||
#define CONFIG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CONFIG_SH_ETHER_PHY_MODE PHY_INTERFACE_MODE_RMII
|
||||
#define CONFIG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_INVALIDATE
|
||||
#define CFG_SH_ETHER_ALIGNE_SIZE 64
|
||||
|
||||
|
||||
@@ -29,7 +29,7 @@
|
||||
#define CONFIG_SH_ETHER_USE_PORT 0
|
||||
#define CONFIG_SH_ETHER_PHY_ADDR 0x1
|
||||
#define CONFIG_SH_ETHER_PHY_MODE PHY_INTERFACE_MODE_RMII
|
||||
#define CONFIG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_WRITEBACK
|
||||
#define CFG_SH_ETHER_CACHE_INVALIDATE
|
||||
#define CFG_SH_ETHER_ALIGNE_SIZE 64
|
||||
|
||||
|
||||
Reference in New Issue
Block a user